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5
Programmer I/O5
I/O
?
Spare I/O
6
OP6
O
Algorithm specific
DO NOT USE
?
PDI_BREAK
7a
I2C_SDA
I/O
?
I2C SDA
?
I2C SDA data signal
7b
7c
XMEGA_PDI_DATA I/O
ATTINY_TPI_DATA I/O
?
?
TEST (PDI_DATA)
TPI_DATA
?
?
XMEGA DATA Signal
ATtiny DATA Signal
8a
8b
8c
I2C_SCL
XMEGA_PDI_CLK
ATTINY_TPI_CLK
I/O
O
O
?
?
?
I2C SCL
RESET
TPI_CLK
?
?
?
I2C SCL clock signal
XMEGA CLOCK Signal
ATtiny CLOCK Signal
9
PROG_RESET
O
RESET
Target RESET control pin
This pin controls the Target Device
RESET pin. It will be driven HIGH /
LOW according to the device type
and settings in the <Pre-program
State Machine> tab in the EQtools
project.
10
PROG_VPP
P
See note
Vpp Voltage
The programmer can output a “Vpp”
voltage on this pin between 6.5V
and 13.8V. This pin should not be
connected unless a Vpp voltage is
required by the Target IC.
11 +
PROG_GND
P
Signal GROUND (0V)
Signal Ground Connection (1)
12
0V to which the programmer JTAG,
SPI, I2C, PDI and TPI signal lines
are referenced to.
13 +
TARGET_VCC
P
TARGET_VCC
Target VCC
14
This pin should be connected to the
Target System Vcc.
O - Output from programmer to Target Device
I - Input to programmer from Target Device
P - Passive e.g. GROUND and power rails
N/C - Not connected
ISPnano Series Programmer - User Manual – V1.11 – 12 May 2011
th
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